wangfq/vd-analysis
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wangfq 01d574c4a9 docs: MCU 归属更正（PD132T=Megawin MA801 / PD136HA=HC32F003C4）+ 双沿捕获⇒Xn 半周期口径 
- 用户口径 + 源码取证：PD132T 用 USER/REG_MA801.H（首行 for Megawin MA801；sbit CEX1=P3^5 ✓ 与图纸 LP→pin9 吻合），
  此前「STC12C2052」系按寄存器地址相似的误判 ⇒ 已更正；3MHz/10.92ms 结论不变
  · CMOD=0x04 作者原注「时钟源为定时器0溢出」+ Megawin 手册 CPS 表（CPS[2:0]=010⇒T0 溢出）两法互证（对 2/3 比特布局分歧免疫）
  · AUXR=0xC0 无 MA801 专册直证，由 T1 0x15A0=60000 计数=5ms 反证定时器输入 12MHz ⇒ 1T 生效
- PD136HA 实际芯片 = HC32F003C4（用户确认，小华 HDSC）；工程档位 F005C6PA/startup C6UA 不一致 ⇒ 重编译前须改；
  实测 Code=11148 RO=268 RW=88 ZI=608 ⇒ ROM≈11.1KB / RAM≈696B；Keil <Cpu> CLOCK(12000000) 独立佐证 12MHz
- PD132T CCAPM1=0x31 实为双沿捕获（旧稿「下降沿」有误）⇒ ISR 的 Xn 是半周期 ⇒ 线圈绝对频段重算
  （PD132T ≈23.4~118kHz / PD136HA·PD132L ≈11.8~60kHz）；Δf/f 为比值口径 ⇒ 灵敏度结论不受影响
- 同步 6 文件（报告 §2.3 更正块 + §11⑩、前端专项、PD132T/PD136HA 分析稿、跨型号表、README）；表格校验 0 异常
 2026-09-11 08:42:41 +08:00
wangfq f5bdbfae05 docs(PD136HA): 外部晶振 12MHz 用户确认 ⇒ PCLK0/捕获时钟/测量窗落定，前端全链闭合 
- 依据用户口径「PD136HA 用的外部晶振也是 12M」+ 源码核证：CLK_INIT() 中 XTH_CR|=0x07（注释「8-16MHZ」）
  → 直取 XTH、无 PLL、无 HCLK_PRS/PCLK_PRS 分频 ⇒ PCLK0 = XTH = 12MHz；AdtClkPClk0Div8 ⇒ 捕获时钟 1.5MHz
  → 测量窗 32768/1.5MHz = 21.85ms（原为「12MHz 假设/待实测」，现降级为已确认）；Delay_ms 1330 次/ms 亦印证
- PD136HA 前端全链闭合：线圈 → 9015×2 → CD4060 整形 ÷32(Q5) → LP → P23 → ADTIM4(1.5MHz)
- 新增陷阱提示：common/board_stkhc32f005.h 的 SYSTEM_XTH=32MHz 是 STK demo 板常量，本产品不用（易误导）
- 同步 4 份文档：对齐报告(§1.4/§2.3/§11⑨/§12)、前端专项 §8、models/PD136HA/analysis.md、cross-model-comparison 注
- 表格校验 0 异常（13 文件）
 2026-09-11 08:32:11 +08:00
wangfq 7cf090d1b0 docs(front-end): §2.3 勘误措辞收紧（旧推算为 T0 走 SYSCLK/4，非 /12） 2026-09-11 03:23:58 +08:00
wangfq 55a39f740a docs(front-end): 图纸取证钉死 CD4060 分频比 = ÷32(Q5)；勘误 PD132T 捕获时钟 0.75MHz→3MHz 
- 依据用户口径「PD136 与 PD132 接 CD4060 的电路相同」，对仓内 PD132T 逻辑图纸做像素取证：
  800dpi 逐行游程扫描确认 10 个 Q 输出中仅 Q5(pin5) 引出(476px)→ 网络 LP → MCU U2 pin9=CEX1/T1/P3.5，
  与固件 CMOD=0x04 捕获配置吻合 ⇒ 分频比 = ÷32
- 独立佐证：PD136HA 窗(400~2030)/PD132L 窗(320~1620)=1.25 = 捕获时钟比(1.5/1.2MHz) ⇒ N 相同
- 勘误：PD132T PCA 时钟 = SYSCLK/4 = 3MHz（TH0=252 + AUXR=0xC0 + T1 5ms 定时反证 SYSCLK=12MHz），
  测量节拍 43.7ms→10.92ms；连带修正 6 处派生量（IIR τ、基线周期、响应时间、对比结论）
- 同步 5 份受影响文档并加日期勘误标注；阈值/百分比口径不受影响（N×f_cap 乘积不变）
 2026-09-11 03:23:28 +08:00
wangfq dfba2dfdb9 docs(hw-frontend): PD132T↔V4B 前端专项补 §8 PD136HA 侧; 对齐报告 §2.3 与 PD132T 交叉比对收紧分频比反推 
- 前端专项 §8: PD136HA 与 PD132T 同血统 2× 提速（766 捕获时钟 0.75→1.5MHz, 窗 43.7→21.85ms, Xn 窗 406~2050 → 400~2030 几乎逐字相同）
- 对齐报告 §2.3: Q8(÷256) 被窗口排除(Xn 会到 3845>2030) ⇒ 收窄到 Q5~Q7, Q6 最可能
- 血缘细节: PD136HA 代码内未启用的 ALFA_CAP1=79 = V4B 现役的 79
 2026-09-11 02:39:36 +08:00
wangfq a2d57eebd2 docs(pd136ha→v4b): 新增 §2 硬件前端电路对齐（CD4060 分频 vs 直连振荡）+ 全节重编号 
- 2.2 论证分频比 N 同进分子分母 ⇒ CAPVD=32768 与 N 无关，相对阈值口径不受前端差异影响
- 2.3 由 Xn 有效窗 400~2030 + 捕获时钟 1.5MHz 反推捕获信号 739~3750Hz ⇒ 分频比 ÷32~÷128
- 2.4 量化对比: 1 个 Xn 含 128~256 原始周期 / 窗 21.85ms(20×) / 等效平均 8700 vs 3200 / 码值细 4×
- 2.5 新增替换风险: 直连对振荡幅值漂移敏感（雨天/金属路面释放抖动）
- 顺带修正血缘: PD136HA 未启用的 ALFA_CAP1=79 正是 V4B 现役的 79
- §0 摘要补'硬件前端电路'行; §11 补 ⑨ 前端电路核对; §12 补原理图缺失待办(PD136HA 仓内无 PDF)
 2026-09-11 02:38:15 +08:00
wangfq 96ba80bcb3 docs: 新增 PD136HA → DLD154V4B 交付对齐分析（替换评估） 
- docs/pd136ha-to-dld154v4b-delivery-alignment.md（17.9KB，11 节）
  · 口径前提：两型号同为 Origin×表>>16，BASE 32768 vs 131072 不影响百分比口径
  · 进入灵敏度 4 档对照（现役方案B + PD132T 备选表），偏差非单调（档0 +108%）
  · 释放/滞回对照：V4B 离开/进入比 15~48% vs PD136HA 50~67%
  · 判据强度差异与高速车/短占压风险（100km/h 占压 36ms vs 低Q 50ms 确认）
  · 超时常量同源实证：HOLD 5*1200/6000、LC_HOLD 4*1200/4800（均 300s/240s）
  · 拨码：SA_1/SA_2 语义一致可直接照搬（两型号引脚均上拉，ON=读出 0）
  · 线圈电感四级门为替换最大风险（<24µH 恒判车）
- README: 新增「交付对齐报告」索引 + docs 树补全
- 两份 model analysis 加双向交叉链接
 2026-09-11 02:24:10 +08:00